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28 nm Device Portfolio
Cyclone V ST SoC Features
Maximum Resource Count for Cyclone V ST SoCs (1.1 V) 1
5CSTD5
5CSTD6
ALMs
LEs (K)
Registers
M10K memory blocks
M10K memory (Kb)
MLAB memory (Kb)
Variable-precision DSP blocks
18 x 18 multipliers
Processor cores (ARM Cortex-A9)
Global clock networks
PLLs 2 (FPGA)
PLLs 2 (HPS)
Design security
I/O voltage levels supported (V)
32,075
85
128,300
397
3,972
480
87
174
Dual
6
3
16
3
1.1, 1.2, 1.5, 1.8, 2.5, 3.3
41,509
110
166,036
557
5,570
621
112
224
Dual
6
3
LLVTTL, LVCMOS, PCI, PCI-X, LVDS, mini-LVDS, RSDS, LVPECL, Differential SSTL-15,
I/O standards supported
Differential SSTL-18, Differential SSTL-2, Differential HSTL-12, Differential HSTL-15,
Differential HSTL-18, SSTL-15 (I and II), SSTL-18 (I and II), SSTL-2 (I and II), 1.2 V HSTL (I and II),
1.5 V HSTL (I and II), 1.8 V HSTL (I and II), HiSpi, SLVS, Sub-LVDS
Hard memory controllers (FPGA)
Hard memory controllers (HPS)
LVDSchannels,875Mbpsreceive,
840 Mbps transmit
Embedded DPA circuitry
OCT
Programmable drive strength
Transceiver count (5 Gbps)
PCIe hard IP blocks
(Gen2 x1,x2, and x4, Gen1 x4)
GPIOs (FPGA)
GPIOs (HPS)
3
3
Memory devices supported
72
9
2
288
181
1
1
–
Series and differential
3
DDR3, DDR2, LPDDR2
72
9
2
288
181
1
1
1
2
3
All data is correct at the time of printing, and may be subject to change without prior notice. For the latest information, please visit www.altera.com.
The PLL count includes general-purpose fractional PLLs and transceiver fractional PLLs.
With 16 and 32 bit ECC support.
24
Altera Product Catalog
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2013
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